88SE9215A1-NAA2C000 Circuit Intégré Puce Contrôleur E/S SATA 6Gbps à quatre ports PCIe 2.0 une voie

88SE9215A1-NAA2C000 Puce de circuit intégré PCIe 2.0 à quatre ports

Définition du produit 88SE9215A1-NAA2C000
88SE9215A1-NAA2C000 est un adaptateur de bus hôte SATA à quatre ports, 3 Gbps ou 6 Gbps qui fournit une interface PCIe 2.0 à une voie et des fonctions de contrôleur SATA.Le 88SE9215A1-NAA2C000 fournit quatre ports SATA de 6 Gbps.

Caractéristiques du 88SE9215A1-NAA2C000
Généraux
Processus CMOS de 55 nm, noyau numérique de 1,0 V, alimentation analogique de 1,8 V et alimentation d'entrée/sortie de 3,3 V.
Fréquence d'horloge de référence de 25 MHz, fournie par une source d'horloge externe ou générée par un oscillateur cristallin externe.
Le PCIe
Dispositif de point final PCIe 2.0.
Conforme aux spécifications PCIe 2.0.
Prend en charge des vitesses de communication de 2,5 Gbps et 5 Gbps.
Prend en charge les registres d'interface de programmation AHCI pour le contrôleur SATA.
Prend en charge une gestion énergétique agressive.
Prend en charge le signalement, la récupération et la correction d'erreurs.
Prend en charge l'interruption signalée par message (MSI).
Contrôleur SATA
Conforme à la spécification Serial ATA 3.1.
Prend en charge des vitesses de communication de 6 Gbps, 3 Gbps et 1,5 Gbps.
Prend en charge les niveaux de signal d'émetteur programmables.
Prend en charge la génération 1i, la génération 1x, la génération 2i, la génération 2m, la génération 2x et la génération 3i.
Prend en charge quatre ports SATA.
Prend en charge l'interface de programmation AHCI 1.0.
Prend en charge la file d'attente de commande native (NCQ).
Prend en charge la commutation basée sur le FIS ou la commutation basée sur les commandes.
Prend en charge les états de gestion de l'alimentation partielle et en sommeil.
Prend en charge le Staggered Spin-up.
Contrôleur d'interface SPI
Une interface à quatre broches fournit un accès de lecture et d'écriture à un flash SPI externe ou à un périphérique SPI ROM.
L'information spécifique au fournisseur stockée dans l'appareil externe est lue par le contrôleur lors du redémarrage de la puce.
Les ROM de démarrage PCI de la fonction PCIe 0 peuvent également être stockées dans le périphérique SPI externe et lues à travers la barre de ROM d'expansion et le contrôleur d'interface SPI.
Contrôleur d'interface périphérique
Huit ports d'entrée/sortie à usage général (GPIO).
Chacune des broches GPIO peut être affectée pour agir comme une broche d'entrée ou de sortie générale.
Chacune des entrées GPIO peut être programmée pour générer une interruption masquable sensible aux bords ou aux niveaux.
Chacune des sorties GPIO peut être programmée pour qu'une LED connectée clignote à une fréquence fixe définie par l'utilisateur.

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Questions fréquentes
Q. Vos produits sont-ils originaux?
R: Oui, tous les produits sont originaux, la nouvelle importation originale est notre but.
Q: Quels certificats avez-vous?
R: Nous sommes une société certifiée ISO 9001:2015 et membre de l'ERAI.
Q: Pouvez-vous prendre en charge la commande ou l'échantillon en petite quantité?L'échantillon est-il gratuit?
R: Oui, nous soutenons les commandes d'échantillons et les petites commandes. Le coût des échantillons est différent selon votre commande ou votre projet.
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